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Electrical Characteristics
Figure 15 shows DSI asynchronous write signals timing.
HCS
HA[11–29]
HCID[0–4]
HDST
HRW 1
100
101
HRDS 2
112
HDBSn
1
HWBSn 2
HD[0–63]
HTA 3
106
108
201
202
102
109
110
HTA 4
111
Notes:
1.
2.
3.
4.
Used for single-strobe mode access.
Used for dual-strobe mode access.
HTA released at logic 0 (DCR[HTAAD] = 0) at end of access; used with pull-down implementation.
HTA released at logic 1 (DCR[HTAAD] = 1) at end of access; used with pull-up implementation.
Figure 15. Asynchronous Single- and Dual-Strobe Modes Write Timing Diagram
Figure 16 shows DSI asynchronous broadcast write signals timing.
HCS
HA[11–29]
HCID[0–4]
HWBSn
HDST
HRW 1
HRDS 2
HDBSn 1
2
100
112
101
102
201
202
HD[0–63]
Notes:
1.
2.
Used for single-strobe mode access.
Used for dual-strobe mode access.
Figure 16. Asynchronous Broadcast Write Timing Diagram
MSC8122 Quad Digital Signal Processor Data Sheet, Rev. 16
30
Freescale Semiconductor
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